TX_CLK(transmit clock):TX_CLK (Transmit Clock) 是一个连续的时钟信(xìn )号(即系统启动,该信号就一直存在(zài )),它(tā )是 TX_EN、TXD、TX_ER(信号方向(xiàng )为从 RS 到 PHY)的参考时钟,TX_CLK 由 PHY 驱动 TX_CLK 的(de )时钟频率(lǜ )是数据传输(shū )速率(lǜ )的(de ) 25%,偏差 ±100ppm。例如,100Mb/s 模式(shì )下,TX_CLK 时钟(zhōng )频率为 25MHz,占空比(bǐ )在(zài ) 35% 至 65% 之间。
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